| 词条 | Verilog HDL数字设计与综合（第二版） |
| 释义 | 图书信息定 价：￥32.00 折 作 者：（美）帕尔尼卡 著，夏宇闻 等译 出 版 社：电子工业出版社 出版时间：2009-7-1 版 次：1 页 数：306 字 数：518000 印刷时间：2009-7-1 开 本：16开 纸 张：胶版纸 印 次：1 I S B N：9787121089473 包 装：平装 内容简介本书从用户的角度全面阐述了Verilog HDL语言的重要细节和基本设计方法，并详细介绍了Verilog 2001版的主要改进部分。本书重点关注如何应用Verilog语言进行数字电路和系统的设计和验证，而不仅仅讲解语法。全书从基本概念讲起，并逐渐过渡到编程语言接口以及逻辑综合等高级主题。书中的内容全部符合Verilog HDL IEEE 1364-2001标准。 本书适合电子、计算机、自动控制等专业的学习数字电路设计的大学本科高年级学生阅读，也适合数字系统设计工程师和已具有多年Verilog设计工作经验的资深工程师参考。 作者简介Samir Palnitkar目前是美国Jambo Systems公司总裁。Jambo Systems公司是一流的专用集成电路(ASIC)设计和验证服务公司，专门从事高级微处理器、网络和通信芯片的设计服务。Palnitkar先生曾创办一系列小型的高科技公司。他是Integrated Intellectual Property公司的创办人。该公司是一家专用集成电路设计公司，已被Lattice Semiconductor公司收购。后来，他创建了电子商务软件公司0bon90，已被AOLTimeWarner公司收购。 目录第一部分 Verilog 基础知识 第1章 Verilog HDL数字设计综述 1.1 数字电路CAD技术的发展历史 1.2 硬件描述语言的出现 1.3 典型设计流程 1.4 硬件描述语言的意义 1.5 Verilog HDL的优点 1.6 硬件描述语言的发展趋势 第2章 层次建模的概念 2.1 设计方法学 2.2 四位脉动进位计数器 2.3 模块 2.4 模块实例 2.5 逻辑仿真的构成 2.6 举例 |
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