“systemC”的意思、由来-中文百科全书

简介

System C是一种软/硬件协同设计语言，一种新的系统级建模语言。它包含了一系列C++的类和宏，并且提供了一个事件驱动的模拟核，使得系统的设计者能够用C++的词法模拟并行的进程，特别是在SoC系统中。

近年来Synopsys 公司， CoWare 公司和Frontier Design公司合作开发了SystemC 。在1999 年9 月27 日四十多家世界上著名的EDA 公司， IP 公司，半导体公司和嵌入式软件公司宣布成立”开放式SystemC 创始社” (Open SystemC Initiative) 这些公司包括ARM， CoWare， Cygnus Solution， Ericsson， Frontier Design， Fujitsu， Infineon， Lucent Technologies，Sony， STMicroelectronics， Synopsys， Taxas Instruments 等

这些公司认为SystemC 是一种很好的硬件软件联合设计语言。Ericsson 公司微电子部主任Jan-Olof Kismalm 说：“通信系统的复杂性在不断地增加而新的系统却要求以更短的时间推向市场为了以最短的时间开发出复杂的产品，需要我们采用单一的语言描述复杂的行为和 IP，我们相信SystemC 可以帮助我们以更好的方法描述我们的系统并在设计过程的初始阶段进行有效的硬件软件联合设计这可以大大缩短我们开发产品的时间Kismalm 先生的话表达了世界上众多公司欢迎SystemC 的原因。”

研究表明，具有较高的抽象能力，同时能体现出硬件设计中的信号同步、时间延迟、状态转换等物理信息的语言，才能给工程师提供一个系统级设计的公共基础平台。在我们常用的设计语言中，C、C++ 和Java等高级编程语言有较高的抽象能力，但由于不能体现硬件设计的物理特性，硬件模块部分需重新用硬件描述语言设计，使得后续设计缺乏连贯性；而VHDL，Verilog最初目的并不是进行电路设计，前者是用来描述电路的，而后者起源于板级系统仿真，因此它们并不适合进行系统级的软件和算法设计，特别是现在系统中的功能越来越多的由软件来完成时。

SystemC是在C++的基础上扩展了硬件类和仿真核形成的，由于结合了面向对象编程和硬件建模机制原理两方面的优点，这可以使SystemC在抽象层次的不同级进行系统设计。系统硬件部分可以用SystemC类来描述，其基本单元是模块（modul）模块内可包含子模块、端口和过程，模块之间通过端口和信号进行连接和通讯。

随着通讯系统复杂性的不断增加，工程师将更多的面对使用单一的语言来描述复杂的IP和系统，而SystemC，语言良好的软硬件协同设计能力这一最大特点，将会使其应用更加广泛。

①SC_METHOD:当敏感列表上有事件发生时，才被调用，（用法很像verilog中描述组合逻辑）调用后迅速返回；

②SC_THREAD:能够被挂起和重新激活，当敏感表上有事件发生，线程被重新激活运行到新的wait()语句再重新挂起，（主要用于对程序的验证）；

③SC_CTHREAD:继承于线程进程，只能在时钟的上升沿或者下降沿被触发或者激活，（用于时钟精确的建模）。

Systemc的时钟模型

在Systemc程序设计中，时钟（sc_clock）被作为一个特殊的对象处理。

sc_clock共有六个重载的构造函数。

sc_clock(“clk1”,20,0.5,5,ture)?

模块

模块是SystemC的最基本单元，模块内部可以包括端口，内部信号，内部数据，进程等

模块本质上是类，使用SC_MODULE声明：

SC_MODULE（mmu）

{…..//details of the design}

等价于：

Class mmu ：public sc_module

{…..//details of the design}

实例???

SC_METHOD??实例

#ifndef_FULLADDER_H

#define_FULLADDER_H

#include<systemc.h>

SC_MODULE(FullAdder)

{

sc_in<sc_bit>A,B,Ci;

sc_out<sc_bit>S,Co;

void do_add()

{

S=(A.read())^ (B.read())^(Ci.read());

Co= (A.read())&(B.read())|

(B.read())&(Ci.read())|

(A.read())&(Ci.read());

};

SC_CTOR(FullAdder) //systemc的构造函数

{

SC_METHOD(do_add); //表示do_add对A,B,Ci敏感

sensitive<<A<<B<<Ci;

}

};

#endif

SC_THREAD实例?

#ifndef_MONITOR_H

#define_MONITOR_H

#include<systemc.h>

SC_MODULE(Monitor)

{

sc_in<sc_bit>m_a,m_b,m_cin,m_sum,m_cout;

void pre_monitor()

{

while(1){

cout<<m_a.read()<<m_b.read()<<m_cin.read();

wait(); //当执行到时程序被挂起，当敏感列表被触发时程序继续执行

cout<<m_sum.read()<<m_cout.read()；

}

};

SC_CTOR(Monitor)

{

SC_ THREAD(pre_monitor); //表示当变量发生变化时， pre_monitor被激活或者重新激活；

sensitive<<m_a,m_b,m_cin,m_sum,m_cout ;}

};

#endif

SC_CTHREAD实例?

#ifndef_DRIVER_H

#define_DRIVER_H

#include”systemc.h”

SC_MODULE(Drive){

sc_in_clk clk;

sc_out<sc_bit> d_a,d_b,d_cin;

void prc_drive();

SC_CTOR(Drive){ //表示prc_drive对时钟上升沿敏感

SC_CTHREAD(prc_drive,clk.pos());

}

} ;

#endif

接口?

接口：集合一组固定的通信方法

存储器写接口：

Class mem_read_if: public sc_interface

{public:

virtual transfer_status read(…)=0;//读虚函数（没有数据）

}

存储器读接口：

Class mem_write_if: public sc_interface

{public:

virtual transfer_status write(…)=0;//写虚函数（没有数据）

}

存储器接口（将读接口与写接口封装）：

Class ram_if: public mem_read_if,mem_write_if{

…

}

通道?

通道实现了接口的内容，即它是一个实现通信功能的“模块”，只不过它仅完成通信功能。

例子：Ram通道：

Class ram :public sc_module,ram_if{

…

Transfer_status read(…)//定义读函数（需要用户自己定义具体功能）

{

…

}

Transfer_status write(…)//定义写函数（需要用户自己定义）

{

…

}

端口?

端口：模块通过端口与通道连接

模块的端口的定义要与接口同一类才能连接

SC_MASTER(Master){

sc_in_clk clk;

sc_port<ram_if>ram_port; //实例化端口

Int data;

Unsigned int address;

…

void main_action{ //需要用户自己定义

…

Transfer_statusstatus=ram_port->write(address,data);//在功能函数中通过端口

… 调用通道函数

Transfer_statusstatus=ram_port->read(address,data);//通过端口调用功能函数

…

}

…

}

SystemC行为建模??

接口(interface)：是c++抽象类，它以纯虚数的方式定义了一组抽象的方法??

通道(channel)：通道实现一个或者多个接口（接口中定义的虚函数必须在通道中实现）

端口(port)：端口定义在模块中，通过端口，模块中的进程就能够连接到一定的接口

Systemc的Master-Slave通信库

Systemc支持业界很多设计方法学，OSCI的思路是定义一个小的语言子集以完成最基本的语言构架，具体的设计方法学有一些专用库来实现，如可以使用Master-Slave库来实现IP复用；

Master-Slave库使得通信与模块的行为在一定程度上分离，从而可以方便的向SoC中集成IP模块。

Void generate_data(int &out){

for(int i=0;i<10;i++){

accumlate(out);

}

Void accumlate(int &in1){

sum +=in1;

cout<<“sum =”<<sum<<endl;

}

SC_MODULE(producer){

Sc_outmaster<int>out1; //systemc中master-slave通信库内

表示作为主机输出out1

Sc_in<bool>start;//启动进程

Void generate_data(){

For(int i+0;i<10;i++){

Out1=i;

}

SC_CTOR(producer){

SC_METHOD(generate_data);

sensitive<<start;

}

SC_MODULE(consumer){

Sc_inslave<int>in1; //systemc中master-slave通信库内表示作为从机输入in1

Int sum;

Void accumulate(){

Sum+=int1;

Cout<<“sum=”<<sum<<endl;

}

SC_CTOR(consumer){

sc_slave(accumulate,in1); // systemc中master-slave通信库内表示从机中accumulate函数对in1敏感

sum=0;

}

SC_MODULE(top){

Producer *A1;

Consumer *B1;

Sc_link_mp<int>link1; //systemc中master-slave通信库内中间通信

SC_CTOR(top){

A1=new producer(“A1”);??

A1->out1(link1);

B1=new consumer(“B1”);

B1->in1(link1);

}

学习Systemc应该掌握的知识

1、C++中类的基础知识

2、类的各种继承方式，以及基类，虚函数等概念

3、并行运算的概念

lSC

词条	systemC
释义	简介基本语法(C++和SystemC任务的执行 SystemC的基本进程 Systemc的时钟模型模块) 实例???(SC_METHOD??实例 SC_THREAD实例? SC_CTHREAD实例? 接口? 通道? 端口?) SystemC行为建模?? Systemc的Master-Slave通信库学习Systemc应该掌握的知识简介 System C是一种软/硬件协同设计语言，一种新的系统级建模语言。它包含了一系列C++的类和宏，并且提供了一个事件驱动的模拟核，使得系统的设计者能够用C++的词法模拟并行的进程，特别是在SoC系统中。近年来Synopsys 公司， CoWare 公司和Frontier Design公司合作开发了SystemC 。在1999 年9 月27 日四十多家世界上著名的EDA 公司， IP 公司，半导体公司和嵌入式软件公司宣布成立”开放式SystemC 创始社” (Open SystemC Initiative) 这些公司包括ARM， CoWare， Cygnus Solution， Ericsson， Frontier Design， Fujitsu， Infineon， Lucent Technologies，Sony， STMicroelectronics， Synopsys， Taxas Instruments 等这些公司认为SystemC 是一种很好的硬件软件联合设计语言。Ericsson 公司微电子部主任Jan-Olof Kismalm 说：“通信系统的复杂性在不断地增加而新的系统却要求以更短的时间推向市场为了以最短的时间开发出复杂的产品，需要我们采用单一的语言描述复杂的行为和 IP，我们相信SystemC 可以帮助我们以更好的方法描述我们的系统并在设计过程的初始阶段进行有效的硬件软件联合设计这可以大大缩短我们开发产品的时间Kismalm 先生的话表达了世界上众多公司欢迎SystemC 的原因。” 研究表明，具有较高的抽象能力，同时能体现出硬件设计中的信号同步、时间延迟、状态转换等物理信息的语言，才能给工程师提供一个系统级设计的公共基础平台。在我们常用的设计语言中，C、C++ 和Java等高级编程语言有较高的抽象能力，但由于不能体现硬件设计的物理特性，硬件模块部分需重新用硬件描述语言设计，使得后续设计缺乏连贯性；而VHDL，Verilog最初目的并不是进行电路设计，前者是用来描述电路的，而后者起源于板级系统仿真，因此它们并不适合进行系统级的软件和算法设计，特别是现在系统中的功能越来越多的由软件来完成时。 SystemC是在C++的基础上扩展了硬件类和仿真核形成的，由于结合了面向对象编程和硬件建模机制原理两方面的优点，这可以使SystemC在抽象层次的不同级进行系统设计。系统硬件部分可以用SystemC类来描述，其基本单元是模块（modul）模块内可包含子模块、端口和过程，模块之间通过端口和信号进行连接和通讯。随着通讯系统复杂性的不断增加，工程师将更多的面对使用单一的语言来描述复杂的IP和系统，而SystemC，语言良好的软硬件协同设计能力这一最大特点，将会使其应用更加广泛。基本语法 C++和SystemC任务的执行 C++：任务的执行是串行的；SystemC：可以做到并行。 SystemC的基本进程进程是程序在并发环境中的执行过程， SystemC的基本进程包括： SC_METHOD，SC_THREAD，SC_CTHREAD ①SC_METHOD:当敏感列表上有事件发生时，才被调用，（用法很像verilog中描述组合逻辑）调用后迅速返回； ②SC_THREAD:能够被挂起和重新激活，当敏感表上有事件发生，线程被重新激活运行到新的wait()语句再重新挂起，（主要用于对程序的验证）； ③SC_CTHREAD:继承于线程进程，只能在时钟的上升沿或者下降沿被触发或者激活，（用于时钟精确的建模）。 Systemc的时钟模型在Systemc程序设计中，时钟（sc_clock）被作为一个特殊的对象处理。 sc_clock共有六个重载的构造函数。 sc_clock(“clk1”,20,0.5,5,ture)? 模块模块是SystemC的最基本单元，模块内部可以包括端口，内部信号，内部数据，进程等模块本质上是类，使用SC_MODULE声明： SC_MODULE（mmu） {…..//details of the design} 等价于： Class mmu ：public sc_module {…..//details of the design} 实例??? SC_METHOD??实例 ? #ifndef_FULLADDER_H #define_FULLADDER_H #include<systemc.h> SC_MODULE(FullAdder) { sc_in<sc_bit>A,B,Ci; sc_out<sc_bit>S,Co; void do_add() { S=(A.read())^ (B.read())^(Ci.read()); Co= (A.read())&(B.read())\| (B.read())&(Ci.read())\| (A.read())&(Ci.read()); }; SC_CTOR(FullAdder) //systemc的构造函数 { SC_METHOD(do_add); //表示do_add对A,B,Ci敏感 sensitive<<A<<B<<Ci; } }; #endif SC_THREAD实例? #ifndef_MONITOR_H #define_MONITOR_H #include<systemc.h> SC_MODULE(Monitor) { sc_in<sc_bit>m_a,m_b,m_cin,m_sum,m_cout; void pre_monitor() { while(1){ cout<<m_a.read()<<m_b.read()<<m_cin.read(); wait(); //当执行到时程序被挂起，当敏感列表被触发时程序继续执行 cout<<m_sum.read()<<m_cout.read()； } }; SC_CTOR(Monitor) { SC_ THREAD(pre_monitor); //表示当变量发生变化时， pre_monitor被激活或者重新激活； sensitive<<m_a,m_b,m_cin,m_sum,m_cout ;} }; #endif SC_CTHREAD实例? #ifndef_DRIVER_H #define_DRIVER_H #include”systemc.h” SC_MODULE(Drive){ sc_in_clk clk; sc_out<sc_bit> d_a,d_b,d_cin; void prc_drive(); SC_CTOR(Drive){ //表示prc_drive对时钟上升沿敏感 SC_CTHREAD(prc_drive,clk.pos()); } } ; #endif 接口? 接口：集合一组固定的通信方法存储器写接口： Class mem_read_if: public sc_interface {public: virtual transfer_status read(…)=0;//读虚函数（没有数据） } 存储器读接口： Class mem_write_if: public sc_interface {public: virtual transfer_status write(…)=0;//写虚函数（没有数据） } 存储器接口（将读接口与写接口封装）： Class ram_if: public mem_read_if,mem_write_if{ … } 通道? 通道实现了接口的内容，即它是一个实现通信功能的“模块”，只不过它仅完成通信功能。例子：Ram通道： Class ram :public sc_module,ram_if{ … Transfer_status read(…)//定义读函数（需要用户自己定义具体功能） { … } Transfer_status write(…)//定义写函数（需要用户自己定义） { … } } 端口? 端口：模块通过端口与通道连接模块的端口的定义要与接口同一类才能连接 SC_MASTER(Master){ sc_in_clk clk; sc_port<ram_if>ram_port; //实例化端口 Int data; Unsigned int address; … void main_action{ //需要用户自己定义 … Transfer_statusstatus=ram_port->write(address,data);//在功能函数中通过端口 … 调用通道函数 Transfer_statusstatus=ram_port->read(address,data);//通过端口调用功能函数 … } … } SystemC行为建模?? 接口(interface)：是c++抽象类，它以纯虚数的方式定义了一组抽象的方法?? 通道(channel)：通道实现一个或者多个接口（接口中定义的虚函数必须在通道中实现）端口(port)：端口定义在模块中，通过端口，模块中的进程就能够连接到一定的接口 Systemc的Master-Slave通信库 Systemc支持业界很多设计方法学，OSCI的思路是定义一个小的语言子集以完成最基本的语言构架，具体的设计方法学有一些专用库来实现，如可以使用Master-Slave库来实现IP复用； Master-Slave库使得通信与模块的行为在一定程度上分离，从而可以方便的向SoC中集成IP模块。 Void generate_data(int &out){ for(int i=0;i<10;i++){ accumlate(out); } } Void accumlate(int &in1){ sum +=in1; cout<<“sum =”<<sum<<endl; } SC_MODULE(producer){ Sc_outmaster<int>out1; //systemc中master-slave通信库内表示作为主机输出out1 Sc_in<bool>start;//启动进程 Void generate_data(){ For(int i+0;i<10;i++){ Out1=i; } } SC_CTOR(producer){ SC_METHOD(generate_data); sensitive<<start; } } SC_MODULE(consumer){ Sc_inslave<int>in1; //systemc中master-slave通信库内表示作为从机输入in1 Int sum; Void accumulate(){ Sum+=int1; Cout<<“sum=”<<sum<<endl; } SC_CTOR(consumer){ sc_slave(accumulate,in1); // systemc中master-slave通信库内表示从机中accumulate函数对in1敏感 sum=0; } } SC_MODULE(top){ Producer A1; Consumer B1; Sc_link_mp<int>link1; //systemc中master-slave通信库内中间通信 SC_CTOR(top){ A1=new producer(“A1”);?? A1->out1(link1); B1=new consumer(“B1”); B1->in1(link1); } } 学习Systemc应该掌握的知识 1、C++中类的基础知识 2、类的各种继承方式，以及基类，虚函数等概念 3、并行运算的概念 lSC l} l l
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