| 词条 | VHDL-AMS |
| 释义 | § 概述 即IEEE 1076.1标准。 VHDL-AMS是VHDL的一个分支，它支持模拟、数字、数模混合电路系统的建模与仿真。 § 作用 Verilog-AMS与之类似。支持模拟、数字、数模混合电路系统的建模与仿真。 The VHDL-AMS language is an extension of the IEEE 1076 (VHDL) standard that supports the description and the simulation of analog, digital, and mixed-signal circuits and systems. |
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